El borrador de la versión 0.5 de la octava generación de la especificación PCIe (Peripheral Component Interconnect Express) ha sido presentado antes de lo previsto.Mientras que la finalización oficial de la norma completa sigue programada para 2028..
Las interconexiones PCIe sirven como canales críticos para conectar hardware periférico de alta velocidad a sistemas host.0 componentes como los SSD están disponibles en el mercadoLa especificación final de PCIe 7.0 ha sido lanzada, y la iteración de PCIe 8.0 está activamente en progreso.
Velocidades de doble trayectoria por carril
Impulsados por las cargas de trabajo de TI cada vez más complejas y la demanda de los usuarios por un procesamiento de datos más rápido, varias arquitecturas informáticas, incluidas x86, GPU,Arm y RISC-V están mejorando continuamente el rendimiento informáticoLa mejora de rendimiento requiere chips de computación para realizar entradas y salidas de datos más rápidas.y los enlaces de interconexión que conectan estos periféricos también deben aumentar las velocidades de transmisión para mantener el ritmo.
Tradicionalmente, el PCIe actúa como medio de conexión entre las CPU y las GPU.induciendo a los fabricantes a adoptar tecnologías de interconexión dedicadas como NVLink de NvidiaComo el estándar de interconexión principal para las CPU de arquitectura x86, PCIe debe seguir iterando para coincidir con la mejora del rendimiento de las sucesivas generaciones de CPU.
Para adaptarse al flujo de datos creciente dentro de los sistemas informáticos, cada nueva generación de PCIe duplica la velocidad de transferencia de su predecesora.
Un enlace PCIe completo consta de múltiples carriles paralelos, con el ancho de banda de cada carril actualizado para cada generación.el doble de la velocidad de 128 GT/s del PCIe 7.0Un gráfico dedicado demuestra intuitivamente el salto de velocidad significativo que traen las actualizaciones generacionales.
Sirviendo como la primera edición formal de la norma, el borrador v0.5 integra la retroalimentación de optimización presentada por los miembros de PCI-SIG después del lanzamiento del borrador 0.3 en septiembre de 2025.La organización afirma que el PCIe 8La especificación.0 está diseñada para proporcionar un ancho de banda alto y una latencia baja para las industrias de datos pesados, que abarcan la inteligencia artificial, los centros de datos, las redes de alta velocidad,computación de borde y computación cuántica.
Los objetivos fundamentales de desarrollo de la norma PCIe de octava generación se definen como sigue:
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Alcanzar una velocidad de bits bruta de 256,0 GT/s, con un rendimiento bidireccional de hasta 1,0 TB/s bajo la configuración de canal x16
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Realizar investigaciones y evaluaciones sobre tecnologías innovadoras de conectores
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Cumplir con los estándares preestablecidos de latencia, corrección de errores (FEC) y confiabilidad operativa
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Mantener la compatibilidad con todas las generaciones anteriores de PCIe
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Optimice el ancho de banda de transmisión a través de la iteración y mejora del protocolo
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Adoptar medios técnicos diversificados para reducir el consumo de energía
Se espera que los dispositivos de mercado masivo que admiten PCIe 8.0 se lancen a partir de 2030. Además, la industria ha iniciado discusiones informales sobre PCIe 9.0 antes de su hoja de ruta oficial de desarrollo.Se prevé que la próxima generación duplique la velocidad de transferencia de un solo carril a 512 GT/s, con su proyecto de especificación que se publicará en 2031, y se espera que la tecnología de transmisión óptica desempeñe un papel vital en la nueva iteración.
Con más de 1.000 miembros institucionales, el PCI-SIG refleja la amplia aplicación del estándar de interconexión PCIe.5 proyecto a través del espacio de trabajo de los miembros de CausewayOtras empresas e instituciones cualificadas pueden seguir el enlace oficial para completar el registro de membresía en el PCI-SIG.
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Sandy Yang, directora de estrategia global
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